UART: Thinking how to delay sampling to mid clock
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35cb230ea6
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186689fd5c
@ -63,119 +63,129 @@
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|
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|
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|
<comp lib="1" loc="(580,300)" name="AND Gate">
|
||||||
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|
<a name="facing" val="west"/>
|
||||||
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|
<a name="size" val="30"/>
|
||||||
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|
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|
||||||
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|
</comp>
|
||||||
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|
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|
||||||
|
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|
||||||
|
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|
||||||
|
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|
||||||
|
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|
||||||
|
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|
||||||
|
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|
||||||
|
<comp lib="0" loc="(390,370)" name="Pin">
|
||||||
|
<a name="facing" val="south"/>
|
||||||
|
<a name="tristate" val="false"/>
|
||||||
|
</comp>
|
||||||
|
<comp lib="0" loc="(430,370)" name="Pin">
|
||||||
<a name="facing" val="south"/>
|
<a name="facing" val="south"/>
|
||||||
<a name="tristate" val="false"/>
|
<a name="tristate" val="false"/>
|
||||||
</comp>
|
</comp>
|
||||||
@ -184,13 +194,13 @@
|
|||||||
<a name="output" val="true"/>
|
<a name="output" val="true"/>
|
||||||
<a name="tristate" val="false"/>
|
<a name="tristate" val="false"/>
|
||||||
</comp>
|
</comp>
|
||||||
<comp lib="4" loc="(420,610)" name="Shift Register"/>
|
<comp lib="0" loc="(180,370)" name="Pin">
|
||||||
<comp lib="0" loc="(530,520)" name="Ground"/>
|
|
||||||
<comp lib="1" loc="(580,140)" name="NOT Gate"/>
|
|
||||||
<comp lib="0" loc="(410,460)" name="Pin">
|
|
||||||
<a name="facing" val="south"/>
|
<a name="facing" val="south"/>
|
||||||
<a name="tristate" val="false"/>
|
<a name="tristate" val="false"/>
|
||||||
|
<a name="label" val="Wr"/>
|
||||||
|
<a name="labelloc" val="north"/>
|
||||||
</comp>
|
</comp>
|
||||||
|
<comp lib="1" loc="(580,140)" name="NOT Gate"/>
|
||||||
<comp lib="1" loc="(640,130)" name="AND Gate">
|
<comp lib="1" loc="(640,130)" name="AND Gate">
|
||||||
<a name="size" val="30"/>
|
<a name="size" val="30"/>
|
||||||
<a name="inputs" val="2"/>
|
<a name="inputs" val="2"/>
|
||||||
@ -200,16 +210,7 @@
|
|||||||
<a name="output" val="true"/>
|
<a name="output" val="true"/>
|
||||||
<a name="tristate" val="false"/>
|
<a name="tristate" val="false"/>
|
||||||
</comp>
|
</comp>
|
||||||
<comp lib="0" loc="(490,460)" name="Pin">
|
|
||||||
<a name="facing" val="south"/>
|
|
||||||
<a name="tristate" val="false"/>
|
|
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</comp>
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|
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@ -262,31 +259,32 @@
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<comp lib="0" loc="(420,210)" name="Pin">
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|
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<comp lib="1" loc="(660,180)" name="NOT Gate">
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87
pat80-io-devices/uart/hardware/wip_delay.circ
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This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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