WIP Mainboard schematics: added CPU, RAM, ROM, Addr and data bus.
TODO: Fix external dependency
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faef987494
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6890e352c1
148
pat80-computer/hardware/schematics/pat80/pat80-cache.lib
Normal file
148
pat80-computer/hardware/schematics/pat80/pat80-cache.lib
Normal file
@ -0,0 +1,148 @@
|
||||
EESchema-LIBRARY Version 2.4
|
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#encoding utf-8
|
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#
|
||||
# CPU_Z80CPU
|
||||
#
|
||||
DEF CPU_Z80CPU U 0 40 Y Y 1 F N
|
||||
F0 "U" -550 1400 50 H V L CNN
|
||||
F1 "CPU_Z80CPU" 250 1400 50 H V L CNN
|
||||
F2 "" 0 400 50 H I C CNN
|
||||
F3 "" 0 400 50 H I C CNN
|
||||
$FPLIST
|
||||
DIP*
|
||||
PDIP*
|
||||
$ENDFPLIST
|
||||
DRAW
|
||||
S -550 1350 550 -1350 0 1 10 f
|
||||
X A11 1 700 100 150 L 50 50 1 1 O
|
||||
X D6 10 700 -1100 150 L 50 50 1 1 B
|
||||
X VCC 11 0 1500 150 D 50 50 1 1 W
|
||||
X D2 12 700 -700 150 L 50 50 1 1 B
|
||||
X D7 13 700 -1200 150 L 50 50 1 1 B
|
||||
X D0 14 700 -500 150 L 50 50 1 1 B
|
||||
X D1 15 700 -600 150 L 50 50 1 1 B
|
||||
X ~INT~ 16 -700 500 150 R 50 50 1 1 I
|
||||
X ~NMI~ 17 -700 600 150 R 50 50 1 1 I
|
||||
X ~HALT~ 18 -700 -100 150 R 50 50 1 1 O
|
||||
X ~MREQ~ 19 -700 -700 150 R 50 50 1 1 O
|
||||
X A12 2 700 0 150 L 50 50 1 1 O
|
||||
X ~IORQ~ 20 -700 -800 150 R 50 50 1 1 O
|
||||
X ~RD~ 21 -700 -500 150 R 50 50 1 1 O
|
||||
X ~WR~ 22 -700 -600 150 R 50 50 1 1 O
|
||||
X ~BUSACK~ 23 -700 -1200 150 R 50 50 1 1 O
|
||||
X ~WAIT~ 24 -700 0 150 R 50 50 1 1 I
|
||||
X ~BUSRQ~ 25 -700 -1100 150 R 50 50 1 1 I
|
||||
X ~RESET~ 26 -700 1200 150 R 50 50 1 1 I
|
||||
X ~M1~ 27 -700 200 150 R 50 50 1 1 O
|
||||
X ~RFSH~ 28 -700 100 150 R 50 50 1 1 O
|
||||
X GND 29 0 -1500 150 U 50 50 1 1 W
|
||||
X A13 3 700 -100 150 L 50 50 1 1 O
|
||||
X A0 30 700 1200 150 L 50 50 1 1 O
|
||||
X A1 31 700 1100 150 L 50 50 1 1 O
|
||||
X A2 32 700 1000 150 L 50 50 1 1 O
|
||||
X A3 33 700 900 150 L 50 50 1 1 O
|
||||
X A4 34 700 800 150 L 50 50 1 1 O
|
||||
X A5 35 700 700 150 L 50 50 1 1 O
|
||||
X A6 36 700 600 150 L 50 50 1 1 O
|
||||
X A7 37 700 500 150 L 50 50 1 1 O
|
||||
X A8 38 700 400 150 L 50 50 1 1 O
|
||||
X A9 39 700 300 150 L 50 50 1 1 O
|
||||
X A14 4 700 -200 150 L 50 50 1 1 O
|
||||
X A10 40 700 200 150 L 50 50 1 1 O
|
||||
X A15 5 700 -300 150 L 50 50 1 1 O
|
||||
X ~CLK~ 6 -700 900 150 R 50 50 1 1 I C
|
||||
X D4 7 700 -900 150 L 50 50 1 1 B
|
||||
X D3 8 700 -800 150 L 50 50 1 1 B
|
||||
X D5 9 700 -1000 150 L 50 50 1 1 B
|
||||
ENDDRAW
|
||||
ENDDEF
|
||||
#
|
||||
# Memory_EEPROM_28C256
|
||||
#
|
||||
DEF Memory_EEPROM_28C256 U 0 20 Y Y 1 F N
|
||||
F0 "U" -300 1050 50 H V C CNN
|
||||
F1 "Memory_EEPROM_28C256" 100 -1050 50 H V L CNN
|
||||
F2 "" 0 0 50 H I C CNN
|
||||
F3 "" 0 0 50 H I C CNN
|
||||
$FPLIST
|
||||
DIP*W15.24mm*
|
||||
SOIC*7.5x17.9mm*P1.27mm*
|
||||
$ENDFPLIST
|
||||
DRAW
|
||||
S -300 1000 300 -1000 1 1 10 f
|
||||
X A14 1 -400 -500 100 R 50 50 1 1 I
|
||||
X A0 10 -400 900 100 R 50 50 1 1 I
|
||||
X D0 11 400 900 100 L 50 50 1 1 T
|
||||
X D1 12 400 800 100 L 50 50 1 1 T
|
||||
X D2 13 400 700 100 L 50 50 1 1 T
|
||||
X GND 14 0 -1100 100 U 50 50 1 1 W
|
||||
X D3 15 400 600 100 L 50 50 1 1 T
|
||||
X D4 16 400 500 100 L 50 50 1 1 T
|
||||
X D5 17 400 400 100 L 50 50 1 1 T
|
||||
X D6 18 400 300 100 L 50 50 1 1 T
|
||||
X D7 19 400 200 100 L 50 50 1 1 T
|
||||
X A12 2 -400 -300 100 R 50 50 1 1 I
|
||||
X ~CS 20 -400 -900 100 R 50 50 1 1 I
|
||||
X A10 21 -400 -100 100 R 50 50 1 1 I
|
||||
X ~OE 22 -400 -800 100 R 50 50 1 1 I
|
||||
X A11 23 -400 -200 100 R 50 50 1 1 I
|
||||
X A9 24 -400 0 100 R 50 50 1 1 I
|
||||
X A8 25 -400 100 100 R 50 50 1 1 I
|
||||
X A13 26 -400 -400 100 R 50 50 1 1 I
|
||||
X ~WE 27 -400 -700 100 R 50 50 1 1 I
|
||||
X VCC 28 0 1100 100 D 50 50 1 1 W
|
||||
X A7 3 -400 200 100 R 50 50 1 1 I
|
||||
X A6 4 -400 300 100 R 50 50 1 1 I
|
||||
X A5 5 -400 400 100 R 50 50 1 1 I
|
||||
X A4 6 -400 500 100 R 50 50 1 1 I
|
||||
X A3 7 -400 600 100 R 50 50 1 1 I
|
||||
X A2 8 -400 700 100 R 50 50 1 1 I
|
||||
X A1 9 -400 800 100 R 50 50 1 1 I
|
||||
ENDDRAW
|
||||
ENDDEF
|
||||
#
|
||||
# idleengineer_HM62256BLP-7
|
||||
#
|
||||
DEF idleengineer_HM62256BLP-7 U 0 40 Y Y 1 F N
|
||||
F0 "U" -300 900 50 H V C CNN
|
||||
F1 "idleengineer_HM62256BLP-7" 400 -800 50 H V C CNN
|
||||
F2 "DIP28" 0 0 50 H I C CIN
|
||||
F3 "" 0 0 50 H I C CNN
|
||||
ALIAS HM62256BLP-7SL
|
||||
$FPLIST
|
||||
DIP28*
|
||||
$ENDFPLIST
|
||||
DRAW
|
||||
S -400 850 400 -750 0 1 10 f
|
||||
X GND 14 0 -800 50 U 40 40 0 0 W N
|
||||
X VCC 28 0 900 50 D 40 40 0 0 W N
|
||||
X A14 1 -500 -650 100 R 40 40 1 1 I
|
||||
X A0 10 -500 750 100 R 40 40 1 1 I
|
||||
X D0 11 500 750 100 L 40 40 1 1 T
|
||||
X D1 12 500 650 100 L 40 40 1 1 T
|
||||
X D2 13 500 550 100 L 40 40 1 1 T
|
||||
X D3 15 500 450 100 L 40 40 1 1 T
|
||||
X D4 16 500 350 100 L 40 40 1 1 T
|
||||
X D5 17 500 250 100 L 40 40 1 1 T
|
||||
X D6 18 500 150 100 L 40 40 1 1 T
|
||||
X D7 19 500 50 100 L 40 40 1 1 T
|
||||
X A12 2 -500 -450 100 R 40 40 1 1 I
|
||||
X ~CS 20 500 -350 100 L 40 40 1 1 I
|
||||
X A10 21 -500 -250 100 R 40 40 1 1 I
|
||||
X ~OE 22 500 -100 100 L 40 40 1 1 I
|
||||
X A11 23 -500 -350 100 R 40 40 1 1 I
|
||||
X A9 24 -500 -150 100 R 40 40 1 1 I
|
||||
X A8 25 -500 -50 100 R 40 40 1 1 I
|
||||
X A13 26 -500 -550 100 R 40 40 1 1 I
|
||||
X ~WE 27 500 -200 100 L 40 40 1 1 I
|
||||
X A7 3 -500 50 100 R 40 40 1 1 I
|
||||
X A6 4 -500 150 100 R 40 40 1 1 I
|
||||
X A5 5 -500 250 100 R 40 40 1 1 I
|
||||
X A4 6 -500 350 100 R 40 40 1 1 I
|
||||
X A3 7 -500 450 100 R 40 40 1 1 I
|
||||
X A2 8 -500 550 100 R 40 40 1 1 I
|
||||
X A1 9 -500 650 100 R 40 40 1 1 I
|
||||
ENDDRAW
|
||||
ENDDEF
|
||||
#
|
||||
#End Library
|
||||
1
pat80-computer/hardware/schematics/pat80/pat80.kicad_pcb
Normal file
1
pat80-computer/hardware/schematics/pat80/pat80.kicad_pcb
Normal file
@ -0,0 +1 @@
|
||||
(kicad_pcb (version 4) (host kicad "dummy file") )
|
||||
33
pat80-computer/hardware/schematics/pat80/pat80.pro
Normal file
33
pat80-computer/hardware/schematics/pat80/pat80.pro
Normal file
@ -0,0 +1,33 @@
|
||||
update=22/05/2015 07:44:53
|
||||
version=1
|
||||
last_client=kicad
|
||||
[general]
|
||||
version=1
|
||||
RootSch=
|
||||
BoardNm=
|
||||
[pcbnew]
|
||||
version=1
|
||||
LastNetListRead=
|
||||
UseCmpFile=1
|
||||
PadDrill=0.600000000000
|
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PadDrillOvalY=0.600000000000
|
||||
PadSizeH=1.500000000000
|
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PadSizeV=1.500000000000
|
||||
PcbTextSizeV=1.500000000000
|
||||
PcbTextSizeH=1.500000000000
|
||||
PcbTextThickness=0.300000000000
|
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ModuleTextSizeV=1.000000000000
|
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ModuleTextSizeH=1.000000000000
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ModuleTextSizeThickness=0.150000000000
|
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SolderMaskClearance=0.000000000000
|
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SolderMaskMinWidth=0.000000000000
|
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DrawSegmentWidth=0.200000000000
|
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|
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ModuleOutlineThickness=0.150000000000
|
||||
[cvpcb]
|
||||
version=1
|
||||
NetIExt=net
|
||||
[eeschema]
|
||||
version=1
|
||||
LibDir=
|
||||
[eeschema/libraries]
|
||||
501
pat80-computer/hardware/schematics/pat80/pat80.sch
Normal file
501
pat80-computer/hardware/schematics/pat80/pat80.sch
Normal file
@ -0,0 +1,501 @@
|
||||
EESchema Schematic File Version 4
|
||||
EELAYER 30 0
|
||||
EELAYER END
|
||||
$Descr A4 11693 8268
|
||||
encoding utf-8
|
||||
Sheet 1 1
|
||||
Title ""
|
||||
Date ""
|
||||
Rev ""
|
||||
Comp ""
|
||||
Comment1 ""
|
||||
Comment2 ""
|
||||
Comment3 ""
|
||||
Comment4 ""
|
||||
$EndDescr
|
||||
Text Notes 7400 7500 0 50 ~ 0
|
||||
Pat80 Z80 home computer
|
||||
Text Notes 8150 7650 0 50 ~ 0
|
||||
2021-03-15
|
||||
$Comp
|
||||
L CPU:Z80CPU U1
|
||||
U 1 1 604F040E
|
||||
P 3150 2650
|
||||
F 0 "U1" H 3150 4331 50 0000 C CNN
|
||||
F 1 "Z80CPU" H 3150 4240 50 0000 C CNN
|
||||
F 2 "" H 3150 3050 50 0001 C CNN
|
||||
F 3 "www.zilog.com/manage_directlink.php?filepath=docs/z80/um0080" H 3150 3050 50 0001 C CNN
|
||||
1 3150 2650
|
||||
1 0 0 -1
|
||||
$EndComp
|
||||
$Comp
|
||||
L idleengineer:HM62256BLP-7 U2
|
||||
U 1 1 604FA19C
|
||||
P 6700 3350
|
||||
F 0 "U2" V 6746 2506 50 0000 R CNN
|
||||
F 1 "256k (32k x 8) SRAM" V 6655 2506 50 0000 R CNN
|
||||
F 2 "DIP28" H 6700 3350 50 0001 C CIN
|
||||
F 3 "" H 6700 3350 50 0001 C CNN
|
||||
1 6700 3350
|
||||
0 -1 -1 0
|
||||
$EndComp
|
||||
$Comp
|
||||
L Memory_EEPROM:28C256 U3
|
||||
U 1 1 604F6B81
|
||||
P 6850 1700
|
||||
F 0 "U3" V 6896 556 50 0000 R CNN
|
||||
F 1 "256k (32k x 8) EEPROM" V 6805 556 50 0000 R CNN
|
||||
F 2 "" H 6850 1700 50 0001 C CNN
|
||||
F 3 "http://ww1.microchip.com/downloads/en/DeviceDoc/doc0006.pdf" H 6850 1700 50 0001 C CNN
|
||||
1 6850 1700
|
||||
0 -1 -1 0
|
||||
$EndComp
|
||||
Entry Wire Line
|
||||
4150 1550 4250 1650
|
||||
Entry Wire Line
|
||||
4150 1650 4250 1750
|
||||
Entry Wire Line
|
||||
4150 1750 4250 1850
|
||||
Entry Wire Line
|
||||
4150 1850 4250 1950
|
||||
Entry Wire Line
|
||||
4150 1950 4250 2050
|
||||
Entry Wire Line
|
||||
4150 2050 4250 2150
|
||||
Entry Wire Line
|
||||
4150 2150 4250 2250
|
||||
Entry Wire Line
|
||||
4150 2250 4250 2350
|
||||
Entry Wire Line
|
||||
4150 2350 4250 2450
|
||||
Entry Wire Line
|
||||
4150 2450 4250 2550
|
||||
Entry Wire Line
|
||||
4150 2550 4250 2650
|
||||
Entry Wire Line
|
||||
4150 2650 4250 2750
|
||||
Entry Wire Line
|
||||
4150 2750 4250 2850
|
||||
Entry Wire Line
|
||||
4150 2850 4250 2950
|
||||
Entry Wire Line
|
||||
4150 2950 4250 3050
|
||||
Wire Bus Line
|
||||
4250 3050 5100 3050
|
||||
Wire Wire Line
|
||||
3850 1450 4150 1450
|
||||
Wire Wire Line
|
||||
3850 1550 4150 1550
|
||||
Wire Wire Line
|
||||
3850 1650 4150 1650
|
||||
Wire Wire Line
|
||||
3850 1750 4150 1750
|
||||
Wire Wire Line
|
||||
3850 1850 4150 1850
|
||||
Wire Wire Line
|
||||
3850 1950 4150 1950
|
||||
Wire Wire Line
|
||||
3850 2050 4150 2050
|
||||
Wire Wire Line
|
||||
3850 2150 4150 2150
|
||||
Wire Wire Line
|
||||
3850 2250 4150 2250
|
||||
Wire Wire Line
|
||||
3850 2350 4150 2350
|
||||
Wire Wire Line
|
||||
3850 2450 4150 2450
|
||||
Wire Wire Line
|
||||
3850 2550 4150 2550
|
||||
Wire Wire Line
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6550 2850 6550 2750
|
||||
Wire Wire Line
|
||||
6650 2850 6650 2750
|
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Wire Bus Line
|
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8600 2650 8600 4350
|
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Entry Wire Line
|
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|
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Entry Wire Line
|
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|
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Entry Wire Line
|
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6250 1100 6150 1200
|
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Entry Wire Line
|
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Entry Wire Line
|
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Entry Wire Line
|
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Entry Wire Line
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Entry Wire Line
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Wire Wire Line
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Wire Wire Line
|
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6050 1300 6050 1200
|
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Wire Wire Line
|
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|
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Wire Wire Line
|
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6250 1300 6250 1200
|
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Wire Wire Line
|
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Wire Wire Line
|
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Wire Wire Line
|
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Wire Wire Line
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Wire Bus Line
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Connection ~ 8600 2650
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D0
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D1
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Text Label 6150 1200 3 50 ~ 0
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Text Label 6250 1200 3 50 ~ 0
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D3
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Text Label 6350 1200 3 50 ~ 0
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D4
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Text Label 6450 1200 3 50 ~ 0
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D5
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Text Label 6550 1200 3 50 ~ 0
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D6
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Text Label 6650 1200 3 50 ~ 0
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D7
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Text Label 5950 2750 3 50 ~ 0
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D0
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Text Label 6050 2750 3 50 ~ 0
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Text Label 6250 2750 3 50 ~ 0
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D3
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D4
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D5
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D6
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D7
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Text Label 3950 3150 0 50 ~ 0
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D4
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Text Label 3950 3650 0 50 ~ 0
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D5
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Text Label 3950 3750 0 50 ~ 0
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Text Label 3950 3850 0 50 ~ 0
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D7
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Wire Bus Line
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Wire Bus Line
|
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Wire Bus Line
|
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|
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Wire Bus Line
|
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|
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Wire Bus Line
|
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5100 4050 7250 4050
|
||||
Wire Bus Line
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|
||||
$EndSCHEMATC
|
||||
3
pat80-computer/hardware/schematics/pat80/sym-lib-table
Normal file
3
pat80-computer/hardware/schematics/pat80/sym-lib-table
Normal file
@ -0,0 +1,3 @@
|
||||
(sym_lib_table
|
||||
(lib (name idleengineer)(type Legacy)(uri /home/danieleverducci/kicad-libs/idleengineer/symbols/Memory_RAM.lib)(options "")(descr ""))
|
||||
)
|
||||
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