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d2c3aa9bb2
@ -101,48 +101,4 @@ X A1 9 -400 800 100 R 50 50 1 1 I
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ENDDRAW
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ENDDRAW
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ENDDEF
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ENDDEF
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#
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#
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# idleengineer_HM62256BLP-7
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#
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DEF idleengineer_HM62256BLP-7 U 0 40 Y Y 1 F N
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F0 "U" -300 900 50 H V C CNN
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F1 "idleengineer_HM62256BLP-7" 400 -800 50 H V C CNN
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F2 "DIP28" 0 0 50 H I C CIN
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F3 "" 0 0 50 H I C CNN
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ALIAS HM62256BLP-7SL
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$FPLIST
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DIP28*
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$ENDFPLIST
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DRAW
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S -400 850 400 -750 0 1 10 f
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X GND 14 0 -800 50 U 40 40 0 0 W N
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X VCC 28 0 900 50 D 40 40 0 0 W N
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X A14 1 -500 -650 100 R 40 40 1 1 I
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X A0 10 -500 750 100 R 40 40 1 1 I
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X D0 11 500 750 100 L 40 40 1 1 T
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X D1 12 500 650 100 L 40 40 1 1 T
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X D2 13 500 550 100 L 40 40 1 1 T
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X D3 15 500 450 100 L 40 40 1 1 T
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X D4 16 500 350 100 L 40 40 1 1 T
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X D5 17 500 250 100 L 40 40 1 1 T
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X D6 18 500 150 100 L 40 40 1 1 T
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X D7 19 500 50 100 L 40 40 1 1 T
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X A12 2 -500 -450 100 R 40 40 1 1 I
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X ~CS 20 500 -350 100 L 40 40 1 1 I
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X A10 21 -500 -250 100 R 40 40 1 1 I
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X ~OE 22 500 -100 100 L 40 40 1 1 I
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X A11 23 -500 -350 100 R 40 40 1 1 I
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X A9 24 -500 -150 100 R 40 40 1 1 I
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X A8 25 -500 -50 100 R 40 40 1 1 I
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X A13 26 -500 -550 100 R 40 40 1 1 I
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X ~WE 27 500 -200 100 L 40 40 1 1 I
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X A7 3 -500 50 100 R 40 40 1 1 I
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X A6 4 -500 150 100 R 40 40 1 1 I
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X A5 5 -500 250 100 R 40 40 1 1 I
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X A4 6 -500 350 100 R 40 40 1 1 I
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||||||
X A3 7 -500 450 100 R 40 40 1 1 I
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X A2 8 -500 550 100 R 40 40 1 1 I
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X A1 9 -500 650 100 R 40 40 1 1 I
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ENDDRAW
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ENDDEF
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#
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#End Library
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#End Library
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@ -29,17 +29,6 @@ F 3 "www.zilog.com/manage_directlink.php?filepath=docs/z80/um0080" H 3150 3050 5
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1 0 0 -1
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1 0 0 -1
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$EndComp
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$EndComp
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$Comp
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$Comp
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L idleengineer:HM62256BLP-7 U2
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U 1 1 604FA19C
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P 6700 3350
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F 0 "U2" V 6746 2506 50 0000 R CNN
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F 1 "256k (32k x 8) SRAM" V 6655 2506 50 0000 R CNN
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F 2 "DIP28" H 6700 3350 50 0001 C CIN
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||||||
F 3 "" H 6700 3350 50 0001 C CNN
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1 6700 3350
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0 -1 -1 0
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||||||
$EndComp
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$Comp
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||||||
L Memory_EEPROM:28C256 U3
|
L Memory_EEPROM:28C256 U3
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||||||
U 1 1 604F6B81
|
U 1 1 604F6B81
|
||||||
P 6850 1700
|
P 6850 1700
|
||||||
|
@ -50,8 +50,6 @@ F 3 "http://ww1.microchip.com/downloads/en/DeviceDoc/doc0006.pdf" H 6850 1700 50
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|||||||
1 6850 1700
|
1 6850 1700
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||||||
0 -1 -1 0
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0 -1 -1 0
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||||||
$EndComp
|
$EndComp
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||||||
Entry Wire Line
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||||||
4150 1450 4250 1550
|
|
||||||
Entry Wire Line
|
Entry Wire Line
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||||||
4150 1550 4250 1650
|
4150 1550 4250 1650
|
||||||
Entry Wire Line
|
Entry Wire Line
|
||||||
@ -486,16 +484,18 @@ Text Label 3950 3750 0 50 ~ 0
|
|||||||
D6
|
D6
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||||||
Text Label 3950 3850 0 50 ~ 0
|
Text Label 3950 3850 0 50 ~ 0
|
||||||
D7
|
D7
|
||||||
|
Entry Wire Line
|
||||||
|
4150 1450 4250 1550
|
||||||
Wire Bus Line
|
Wire Bus Line
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||||||
4250 3250 4250 4350
|
6050 1100 8600 1100
|
||||||
Wire Bus Line
|
Wire Bus Line
|
||||||
6050 2650 8600 2650
|
6050 2650 8600 2650
|
||||||
Wire Bus Line
|
Wire Bus Line
|
||||||
6050 1100 8600 1100
|
4250 3250 4250 4350
|
||||||
|
Wire Bus Line
|
||||||
|
4250 1550 4250 3050
|
||||||
Wire Bus Line
|
Wire Bus Line
|
||||||
5100 2300 7250 2300
|
5100 2300 7250 2300
|
||||||
Wire Bus Line
|
Wire Bus Line
|
||||||
5100 4050 7250 4050
|
5100 4050 7250 4050
|
||||||
Wire Bus Line
|
|
||||||
4250 1450 4250 3050
|
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$EndSCHEMATC
|
$EndSCHEMATC
|
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@ -1,3 +1,2 @@
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(sym_lib_table
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(sym_lib_table
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(lib (name idleengineer)(type Legacy)(uri /home/danieleverducci/kicad-libs/idleengineer/symbols/Memory_RAM.lib)(options "")(descr ""))
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)
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)
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